CY7C25652KV18-550BZXI
Active and preferred
RoHS対応
鉛フリー

CY7C25652KV18-550BZXI

データシート
パッケージ

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CY7C25652KV18-550BZXI
CY7C25652KV18-550BZXI
データシート


製品仕様情報

  • Frequency
    550 MHz
  • インターフェース
    Parallel
  • ピークリフロー温度
    260 °C
  • ファミリー
    QDR-II+, ODT
  • メモリ容量
    72 MBit
  • リードボール仕上げ
    Sn/Ag/Cu
  • 動作温度 範囲
    -40 °C～85 °C
  • 動作電圧 範囲
    1.7 V～1.9 V
  • 組織 (X x Y)
    2Mb x 36
  • 認定
    Industrial

推奨
OPN
CY7C25652KV18-550BZXI
製品ステータス active and preferred
インフィニオン パッケージ
PG-BGA-165
パッケージ名 FBGA-165 (51-85180)
梱包サイズ 272
梱包形態 TRAY
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー Yes
ハロゲンフリー Yes
RoHS対応 Yes
組立国
TH
ウェハ製造国
TW
Infineon stock last updated:
 個. 在庫あり

製品ステータス
Active
インフィニオン パッケージ
PG-BGA-165
パッケージ名 FBGA-165 (51-85180)
梱包サイズ 272
梱包形態 TRAY
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー
ハロゲンフリー
RoHS準拠
組立国
TH
ウェハ製造国
TW
CY7C25652KV18-550BZXI is a 72-Mbit QDR II+ synchronous pipelined SRAM in a 2M × 36 organization, with separate read and write DDR ports supporting concurrent transactions. It runs up to 550 MHz (1100 MHz data rate) with 2.5-cycle read latency, and integrates on-die termination plus PLL, echo clocks, and QVLD for high-speed timing. It operates from 1.7–1.9 V VDD and 1.4 V to VDD VDDQ across −40 to +85°C.

特長

  • 550 MHz clock (1100 MHz DDR data)
  • Separate read and write data ports
  • Concurrent read/write transactions
  • Four-word burst architecture
  • 2.5-cycle read latency (DOFF HIGH)
  • 1-cycle read latency mode (DOFF LOW)
  • Two input clocks (K and K)
  • Echo clocks CQ/CQ for data capture
  • QVLD pin indicates valid read data
  • On-die termination for D/BWS/K
  • PLL runs down to 120 MHz
  • Core VDD 1.7 V to 1.9 V

利点

  • High bandwidth for fast DSP/ASIC
  • No bus turn-around delays
  • Read and write run in parallel
  • Lower address bus frequency
  • Deterministic 2.5-cycle reads
  • 1-cycle reads for low latency
  • Simpler DDR timing with K/K
  • Easier high-speed data capture
  • QVLD reduces timing margin effort
  • ODT cuts external termination BOM
  • PLL improves data placement margin
  • 1.8 V core reduces power vs 2.5 V

アプリケーション

ドキュメント

設計リソース

パートナー ソリューション

開発者コミュニティ