CY7S1049GE30-10VXI
Active and preferred
RoHS対応
鉛フリー

CY7S1049GE30-10VXI

データシート
パッケージ

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CY7S1049GE30-10VXI
CY7S1049GE30-10VXI
データシート


製品仕様情報

  • Currently planned availability until at least
    2033
  • インターフェース
    Parallel
  • ピークリフロー温度
    260 °C
  • ファミリー
    FAST SRAM
  • メモリ容量
    4 MBit
  • リードボール仕上げ
    Pure Sn
  • 動作温度 範囲
    -40 °C～85 °C
  • 動作電圧 (VCCQ) 範囲
    2.2 V～3.6 V
  • 動作電圧 範囲
    2.2 V～3.6 V
  • 組織 (X x Y)
    512K x 8
  • 認定
    Industrial
  • 速度
    10 ns

推奨
OPN
CY7S1049GE30-10VXI
製品ステータス active and preferred
インフィニオン パッケージ
PG-SOJ-36
パッケージ名 SOJ-36 (51-85090)
梱包サイズ 475
梱包形態 TUBE
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー Yes
ハロゲンフリー Yes
RoHS対応 Yes
長期供給予定期限 2033
発売開始日 03/2022
組立国
TW
ウェハ製造国
TW
Infineon stock last updated:
 個. 在庫あり

製品ステータス
Active
インフィニオン パッケージ
PG-SOJ-36
パッケージ名 SOJ-36 (51-85090)
梱包サイズ 475
梱包形態 TUBE
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー
ハロゲンフリー
RoHS準拠
長期供給予定期限 2033
発売開始日 03/2022
組立国
TW
ウェハ製造国
TW
CY7S1049GE30-10VXI is a 4-Mbit (512K × 8) asynchronous SRAM with PowerSnooze™ Deep-Sleep and embedded ECC. It operates from 2.2 V to 3.6 V over -40°C to +85°C, delivers 10 ns access time, and supports CE/OE/WE control with TTL-compatible I/O. ECC corrects single-bit errors and the ERR pin flags corrected reads. Deep-Sleep data retention draws up to 15 µA, with CMOS standby up to 8 mA.

特長

  • 4-Mbit SRAM, 512K × 8 org
  • 10 ns / 15 ns address access
  • Read cycle time tRC 10/15 ns
  • OE to data valid tDOE 4.5/8 ns
  • Embedded ECC corrects 1-bit errors
  • Deep-Sleep current IDS max 15 µA
  • DS to Deep-Sleep tDS max 1 ms
  • Wake to access tDSCA 300 µs
  • Data retention at VDR = 1.0 V
  • TTL-compatible inputs and outputs
  • Operating temp –40°C to +85°C

利点

  • Fast reads reduce memory latency
  • Quick OE timing speeds bus turns
  • ECC reduces silent data corruption
  • 15 µA Deep-Sleep cuts power draw
  • DS pin enables on-demand sleep
  • 300 µs wake supports fast resume
  • 1.0 V retention saves backup power
  • TTL levels ease legacy interfaces
  • –40°C to +85°C improves robustness
  • Predictable timing eases design

アプリケーション

ドキュメント

設計リソース

パートナー ソリューション

開発者コミュニティ