CY7C1514KV18-250BZI
Active and preferred

CY7C1514KV18-250BZI

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CY7C1514KV18-250BZI
CY7C1514KV18-250BZI


製品仕様情報

  • Frequency
    250 MHz
  • インターフェース
    Parallel
  • ピークリフロー温度
    260 °C
  • ファミリー
    QDR-II
  • メモリ容量
    72 MBit
  • リードボール仕上げ
    Sn/Pb
  • 動作温度 範囲
    -40 °C~85 °C
  • 動作電圧 範囲
    1.7 V~1.9 V
  • 組織 (X x Y)
    2M x 36
  • 認定
    Industrial

OPN
CY7C1514KV18-250BZI
製品ステータス active and preferred
インフィニオン パッケージ
パッケージ名 FBGA-165 (51-85180)
梱包サイズ 680
梱包形態 TRAY
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー No
ハロゲンフリー Yes
RoHS対応 No
組立国
TH
ウェハ製造国
TW
Infineon stock last updated:
個. 在庫あり

製品ステータス
Active
インフィニオン パッケージ
パッケージ名 FBGA-165 (51-85180)
梱包サイズ 680
梱包形態 TRAY
MSL (湿度感受性レベル) 3
防湿梱包 DRY
鉛フリー
ハロゲンフリー
RoHS準拠
組立国
TH
ウェハ製造国
TW
CY7C1514KV18-250BZI is a 72-Mbit QDR II synchronous pipelined SRAM organized as 2M × 36 with separate read and write ports for concurrent transactions and no bus turnarounds. It supports DDR transfers (two-word burst) with clocking up to 250 MHz. Core VDD is 1.8 V ±0.1 V and VDDQ is 1.4 V to VDD. The device includes echo clocks, programmable output impedance (ZQ), JTAG, and an on-chip PLL.

特長

  • 72-Mbit QDR II SRAM architecture
  • Separate read/write data ports
  • Concurrent read and write transactions
  • Two-word burst on all accesses
  • DDR I/O, 350 MHz (700 MHz data)
  • 1.5-cycle read latency (DOFF=HIGH)
  • 1-cycle read latency (DOFF=LOW)
  • Input clocks K/K and output C/C
  • Echo clocks CQ/CQ for data capture
  • Core VDD 1.7-1.9 V (nom 1.8 V)
  • VDDQ 1.4 V to VDD, VREF range
  • JTAG IEEE 1149.1 boundary scan

利点

  • High bandwidth for fast networking
  • No bus turnaround delays
  • Parallel R/W boosts throughput
  • Two-word bursts cut command load
  • DDR at 700 MHz speeds transfers
  • Low-latency reads for tight timing
  • DOFF selects latency vs pipeline
  • Separate clocks ease timing closure
  • Echo clocks simplify PCB capture
  • 1.8 V core helps reduce power
  • HSTL levels fit high-speed links
  • JTAG speeds board test and debug

アプリケーション

ドキュメント

設計リソース

開発者コミュニティ